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Le module calcule y = ((c3*x + c2)*x + c1)*x + c0 avec des entrées signées sur 12 bits et une sortie signée sur 32 bits.
Objectif challenge
o_valid='1' et le bon résultat en 3 cycles maximum ;i_reset='1' remet l'état interne à zéro.| Signal | Direction | Largeur | Description |
|---|---|---|---|
i_clk | Entrée | 1 bit | Horloge système |
i_reset | Entrée | 1 bit | Reset synchrone actif haut |
i_valid | Entrée | 1 bit | Nouvelle évaluation |
i_x | Entrée | 12 bits signés | Variable x |
i_c0..i_c3 | Entrée | 12 bits signés | Coefficients |
o_valid | Sortie | 1 bit | Résultat valide |
o_y | Sortie | 32 bits signés | Résultat |