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Le récepteur confirme le start au milieu du bit puis échantillonne périodiquement.
Comportement
valid ou framing_error pulse un cycle à la fin de la trame.| Signal | Direction | Largeur | Description |
|---|---|---|---|
clk, reset, rx | Entrée | 1 bit | Horloge, reset et entrée série |
data_out | Sortie | 8 bits | Octet reçu |
valid, busy, framing_error | Sortie | 1 bit | Indicateurs |